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cs:comp_n_arch:courses:fnti_i:week_1 [2025/03/28 12:40] – [buses 的几个惯例] codingharecs:comp_n_arch:courses:fnti_i:week_1 [2025/03/28 14:00] (当前版本) – [DMux Gate] codinghare
行 371: 行 371:
 y = lsb[i..j]; y = lsb[i..j];
 </code> </code>
-  * ''true'' 和 ''false'' 代表对应的（1 & 0）任意长度的输入输出：+  * ''true'' 和 ''false'' 可以对所有的 bits 进行初始值设定（对应 ''0'' 和 ''1''）
 <code nand2tetris-hdl> <code nand2tetris-hdl>
 Add16(a=true, b=false, out=out2); Add16(a=true, b=false, out=out2);
行 400: 行 400:
 {{ :cs:comp_n_arch:courses:fnti_i:mux_imp.svg?600 |}} {{ :cs:comp_n_arch:courses:fnti_i:mux_imp.svg?600 |}}
 $$\texttt{Mux(a, b, sel) = (a And Not(sel)) Or (b And sel)}$$ $$\texttt{Mux(a, b, sel) = (a And Not(sel)) Or (b And sel)}$$
 +<WRAP center round box 100%>
 +这类带开关的逻辑门通常可以用来创建可编程逻辑门（programmable gate）。将不同功能的门接入 ''MUX'' 即可通过 ''sel'' 信号来控制使用不同的逻辑门。</WRAP>
 ==DMux Gate== ==DMux Gate==
   * //Demultiplexor//(Dmux) 是 Mux 的反向操作，可以将单个输入分解为两个输出   * //Demultiplexor//(Dmux) 是 Mux 的反向操作，可以将单个输入分解为两个输出
行 412: 行 414:
 \end{align*} \end{align*}
 \] \]
 +<WRAP center round tip 100%>
 +传输过程中通常使用**单路**的 bit 串进行数字传输。通常传输链路都会非常长（几千公里），如果需要同时输送两组信号源比如（AAAAA... 和 BBBBB...，这种情况下比较经济的做法是将信号进行 ''MUX''，同时将 ''sel'' 设定为周期信号（//oscillator//）。
 +经 ''MUX'' 后的信号会将两组信号源按照 bit 位单位进行交叉输出（比如输出ABABABAB...），然后在接收方通过 ''DMUX'' 以同样的 ''sel''
 +进行分解来得到 A 和 B。
 +</WRAP>
 +
 <WRAP center round box 100%> <WRAP center round box 100%>
 作业中通常涉及到组多路的基础门。这种牵涉到多路的情况一般都是用一个多 bits 的 sel 来控制输出状态。只要搞清楚哪一位 bit 控制的是哪一个层级的 switch 即可。层级可以通过真值表来判断。比如 4 way 的需要用 00 01 10 11 来控制。如果 00 对应 ''a'', 01 对应 ''b''，发生变化的只有 index 0，因此其控制层级就为 ''sel[0]''。\\ \\  作业中通常涉及到组多路的基础门。这种牵涉到多路的情况一般都是用一个多 bits 的 sel 来控制输出状态。只要搞清楚哪一位 bit 控制的是哪一个层级的 switch 即可。层级可以通过真值表来判断。比如 4 way 的需要用 00 01 10 11 来控制。如果 00 对应 ''a'', 01 对应 ''b''，发生变化的只有 index 0，因此其控制层级就为 ''sel[0]''。\\ \\ 
  • 最后更改: 2025/03/28 12:40
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